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	Delay-locked loop based frequency quadrupler with wide operating range and fast locking characteristics 其他 2016-01-01 Wang, Yuan; Liu, Yuequan; Jiang, Mengyin; Jia, Song; Zhang, Xing 收藏 \| 浏览/下载：3/0 \| 提交时间：2017/12/03
	Nonlinear analysis of BPSK optical phase locked loops using MATLAB and Simulink 其他 2016-01-01 Ziyang Chen; Yunpeng Hu; Lu Liu 收藏 \| 浏览/下载：3/0 \| 提交时间：2017/12/03 Optical phase-locked loop Balanced Loop Costas Loop MATLAB Simulation Optical phase-locked loop Balanced Loop Costas Loop MATLAB Simulation
	A novel low-power readout structure with 1/2 sub-scan time-delay-integration and DLL-based A/D for 1024��6 infrared focal plane array 其他 2016-01-01 Liu, Benyuanyi; Lu, Wengao; Liu, Dahe; Yu, Shanzhe; Zhang, Yacong; Chen, Zhongjian 收藏 \| 浏览/下载：4/0 \| 提交时间：2017/12/03
	A Speculative Clock and Data Recovery Architecture for Multi-Gigabit/s Series Links 其他 2016-01-01 Zhao, Tong; Gai, Weixin; Tang, Liangxiao; Shi, Linqi; Zhang, Xing; Zhao, Tong; Gai, Weixin; Tang, Liangxiao; Shi, Linqi 收藏 \| 浏览/下载：4/0 \| 提交时间：2017/12/03 clock and data recovely jitter tolerance Receiver loop latency BBPD phase error
	Nonlinear analysis of BPSK optical phase locked loops using MATLAB and Simulink 其他 2016-01-01 Chen, Ziyang; Hu, Yunpeng; Liu, Lu 收藏 \| 浏览/下载：4/0 \| 提交时间：2017/12/03 Optical phase-locked loop Balanced Loop Costas Loop MATLAB Simulation
	Delay-locked loop based frequency quadrupler with wide operating range and fast locking characteristics 其他 2016-01-01 Wang, Yuan; Liu, Yuequan; Jiang, Mengyin; Jia, Song; Zhang, Xing 收藏 \| 浏览/下载：2/0 \| 提交时间：2017/12/03 quadrupler delay-locked loop (DLL) eight-phase-clock generator edge-combiner wide operating range fast locking MULTIPLIER
	A Novel Low-Power Readout Structure with 1/2 Sub-Scan Time-Delay-Integration and DLL-Based A/D for 1024x6 Infrared Focal Plane Array 其他 2016-01-01 Liu, Benyuanyi; Lu, Wengao; Liu, Dahe; Yu, Shanzhe; Zhang, Yacong; Chen, Zhongjian 收藏 \| 浏览/下载：2/0 \| 提交时间：2017/12/03 Time-delay-integration (TDI) sub-scan Infrared Focal Plane Array (IRFPA) Delay-locked-loop (DLL) Analog-to-digital converter (ADC) CMOS IMAGE SENSOR
	A High Precision Carrier Tracking Scheme Based on Phase Estimation and Compensation 其他 2016-01-01 Li, Ying; Zhang, Ruisong; Jiang, Wei 收藏 \| 浏览/下载：3/0 \| 提交时间：2017/12/03 carrier synchronization phase locked loop phase estimation and compensation dynamic stress error GPS RECEIVER ENVIRONMENTS
	Nonlinear analysis of BPSK optical phase locked loops using MATLAB and Simulink 其他 2016-01-01 Ziyang Chen; Yunpeng Hu; Lu Liu 收藏 \| 浏览/下载：5/0 \| 提交时间：2017/12/03 Optical phase-locked loop Balanced Loop Costas Loop MATLAB Simulation
	180.5Mbps-8Gbps DLL-Based Clock and Data Recovery Circuit with Low Jitter Performance 其他 2015-01-01 Liu, Yuequan; Wang, Yuan; Jia, Song; Zhang, Xing 收藏 \| 浏览/下载：5/0 \| 提交时间：2017/12/03 Clock and data recovery (CDR) wide-range delay-locked loop (DLL) low jitter time-to-digital converter (TDC)

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