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浏览/检索结果: 共3条，第1-3条 帮助 已选(0)清除 条数/页：5101520253035404550556065707580859095100   排序方式：请选择作者升序作者降序题名升序题名降序发表日期升序发表日期降序提交时间升序提交时间降序 基于AXI总线串行RapidIO端点控制器的FPGA实现 期刊论文 北京大学学报 自然科学版, 2014 陈宏铭; 李蕾; 姚益武; 张巍; 程玉华; 安辉耀 收藏  |  浏览/下载：5/0  |  提交时间：2015/10/23 串行RapidIO  AXI总线  IP核  PIPE  SRIO  AXI bus  PIPE  IP core   Design and implementation of serial rapidio based on DSP and FPGA 会议论文 2014 international conference on mechatronics and intelligent materials, mim 2014, lijiang, china, 2014-05-18 Liu, Jun; Tian, Yan; Hao, Wei; Qu, Lei 收藏  |  浏览/下载：22/0  |  提交时间：2015/03/31 一种低时延的串行RapidIO端点设计方案 期刊论文 北京大学学报 自然科学版, 2013 吴峰锋; 贾嵩; 王源; 张大成 收藏  |  浏览/下载：1/0  |  提交时间：2015/11/11 RapidIO  RapidIO  SRIO endpoint  embedded interconnection  serial physical layer  low latency  SRIO端点  嵌入式互连  串行物理层  低时延