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科研机构
北京大学 [3]
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期刊论文 [3]
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2014 [1]
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基于AXI总线串行RapidIO端点控制器的FPGA实现
期刊论文
北京大学学报 自然科学版, 2014
陈宏铭
;
李蕾
;
姚益武
;
张巍
;
程玉华
;
安辉耀
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提交时间:2015/10/23
串行RapidIO
AXI总线
IP核
PIPE
SRIO
AXI bus
PIPE
IP core
Improvement of CRC receiving controller for serial RapidIO
期刊论文
journal of china universities of posts and telecommunications, 2013
Wu, Feng-Feng
;
Jia, Song
;
Wang, Yuan
;
Zhang, Da-Cheng
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提交时间:2015/11/10
一种低时延的串行RapidIO端点设计方案
期刊论文
北京大学学报 自然科学版, 2013
吴峰锋
;
贾嵩
;
王源
;
张大成
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提交时间:2015/11/11
RapidIO
RapidIO
SRIO endpoint
embedded interconnection
serial physical layer
low latency
SRIO端点
嵌入式互连
串行物理层
低时延
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